(benchmark B_7stage_flush.smt
  :source {
These benchmarks were provided by Panagiotis Manolios <manolios@cc.gatech.edu>.
They were generated from experiments in microprocessor verification based on 
refinement.

This benchmark was automatically translated into SMT-LIB format from
CVC format using CVC Lite
}
  :status unknown
  :logic QF_UFIDL
  :extrafuns ((cvclZero Int))
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  :extrapreds ((implcvc__36__emIscvc__36__Takencvc__36__Branch0))
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  :formula
(flet ($cvcl_38 (and implcvc__36__emWRT0 implcvc__36__emIscvc__36__Takencvc__36__Branch0)) (flet ($cvcl_0 (not $cvcl_38)) (flet ($cvcl_10 (and $cvcl_0 implcvc__36__deWRT0)) (let (?cvcl_12 (ite (and (and implcvc__36__mmWRT0 (= (- implcvc__36__deSRC10 implcvc__36__mmDEST0) 0)) implcvc__36__mmRegWrite0) implcvc__36__mmVAL0 (ite (and (and implcvc__36__mwWRT0 (= (- implcvc__36__deSRC10 implcvc__36__mwDEST0) 0)) implcvc__36__mwRegWrite0) implcvc__36__mwVAL0 implcvc__36__a1))) (let (?cvcl_13 (ite (and (and implcvc__36__mmWRT0 (= (- implcvc__36__deSRC20 implcvc__36__mmDEST0) 0)) implcvc__36__mmRegWrite0) implcvc__36__mmVAL0 (ite (and (and implcvc__36__mwWRT0 (= (- implcvc__36__deSRC20 implcvc__36__mwDEST0) 0)) implcvc__36__mwRegWrite0) implcvc__36__mwVAL0 implcvc__36__a2))) (flet ($cvcl_58 (and $cvcl_10 (and (and (TakeBranch implcvc__36__deOP0 ?cvcl_12 ?cvcl_13) implcvc__36__deWRT0) implcvc__36__deIsBranch0))) (flet ($cvcl_5 (not $cvcl_58)) (let (?cvcl_1 (src1 implcvc__36__fdINST0)) (let (?cvcl_2 (src2 implcvc__36__fdINST0)) (flet ($cvcl_6 (and (and implcvc__36__deRegWrite0 implcvc__36__deWRT0) (or (= (- ?cvcl_1 implcvc__36__deDEST0) 0)  (= (- ?cvcl_2 implcvc__36__deDEST0) 0) ))) (flet ($cvcl_9 (not $cvcl_6)) (flet ($cvcl_4 (and $cvcl_0 (and $cvcl_9 implcvc__36__fdWRT0))) (flet ($cvcl_24 (and $cvcl_5 $cvcl_4)) (let (?cvcl_28 (op implcvc__36__fdINST0)) (let (?cvcl_232 (DMemcvc__36__Read dmem0 implcvc__36__emResult0)) (let (?cvcl_3 (ite implcvc__36__emMemToReg0 ?cvcl_232 implcvc__36__emResult0)) (let (?cvcl_29 (ite (and (and implcvc__36__emWRT0 (= (- ?cvcl_1 implcvc__36__emDEST0) 0)) implcvc__36__emRegWrite0) ?cvcl_3 (ite (and (and implcvc__36__mmWRT0 (= (- ?cvcl_1 implcvc__36__mmDEST0) 0)) implcvc__36__mmRegWrite0) implcvc__36__mmVAL0 (ite (and (and implcvc__36__mwWRT0 (= (- ?cvcl_1 implcvc__36__mwDEST0) 0)) implcvc__36__mwRegWrite0) implcvc__36__mwVAL0 (rf0 ?cvcl_1))))) (let (?cvcl_30 (ite (and (and implcvc__36__emWRT0 (= (- ?cvcl_2 implcvc__36__emDEST0) 0)) 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($cvcl_116 (and $cvcl_19 $cvcl_22)) (flet ($cvcl_43 (and $cvcl_0 (and $cvcl_6 implcvc__36__ffWRT0))) (flet ($cvcl_41 (and $cvcl_5 (or $cvcl_116  (and $cvcl_23 $cvcl_43) ))) (flet ($cvcl_34 (and $cvcl_18 (and $cvcl_42 $cvcl_41))) (flet ($cvcl_65 (and $cvcl_35 $cvcl_34)) (let (?cvcl_69 (op ?cvcl_20)) (flet ($cvcl_229 (GetMemToReg implcvc__36__fdINST0)) (flet ($cvcl_266 (and $cvcl_10 implcvc__36__deMemWrite0)) (let (?cvcl_267 (NextDMem ?cvcl_27 ?cvcl_14 ?cvcl_13)) (let (?cvcl_47 (ite $cvcl_266 ?cvcl_267 ?cvcl_27)) (let (?cvcl_31 (alu ?cvcl_28 ?cvcl_29 (ite (GetuseImm implcvc__36__fdINST0) (GetImm implcvc__36__fdINST0) ?cvcl_30))) (let (?cvcl_230 (DMemcvc__36__Read ?cvcl_47 ?cvcl_31)) (let (?cvcl_33 (ite $cvcl_229 ?cvcl_230 ?cvcl_31)) (let (?cvcl_70 (ite (and (and $cvcl_24 (= (- ?cvcl_25 ?cvcl_8) 0)) $cvcl_26) ?cvcl_33 (ite (and (and $cvcl_10 (= (- ?cvcl_25 implcvc__36__deDEST0) 0)) implcvc__36__deRegWrite0) ?cvcl_16 (ite (and (and implcvc__36__emWRT0 (= (- ?cvcl_25 implcvc__36__emDEST0) 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